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            Low Power Flow HLD (Front End)培訓(xùn)班
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       堅(jiān)持小班授課,為保證培訓(xùn)效果,增加互動(dòng)環(huán)節(jié),每期人數(shù)限3到5人。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn):【上海】:同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】:電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(hào)(中和大道) 【沈陽(yáng)分部】:沈陽(yáng)理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
近開(kāi)課時(shí)間(周末班/連續(xù)班/晚班)
Low Power Flow HLD培訓(xùn)班:2025年7月14日..用心服務(wù)..........--即將開(kāi)課--...............................(歡迎您垂詢(xún),視教育質(zhì)量為生命!)
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     ☆資深工程師授課

        
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   質(zhì)量保障

        1、培訓(xùn)過(guò)程中,如有部分內(nèi)容理解不透或消化不好,可免費(fèi)在以后培訓(xùn)班中重聽(tīng);
        2、課程完成后,授課老師留給學(xué)員手機(jī)和Email,保障培訓(xùn)效果,免費(fèi)提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

              Low Power Flow HLD (Front End)培訓(xùn)班

 

Overview
In this workshop, you will perform high-level design steps necessary to synthesize, analyze, and verify a multi-voltage design with shutdown requirements using the IEEE 1801 UPF-based Synopsys Eclypse Low-Power Flow. You will:
Identify the library requirements to implement a MV low-power design
Create, modify, interpret, and apply power-intent (UPF) files
Correctly specify PVT requirements for MV low-power optimizations
Perform low-power RTL synthesis using top-down and hierarchical UPF methodologies
Generate a gate level design that is MV-clean
Insert power-domain aware scan chains
Check for logic equivalence of RTL and gate-level designs
Conduct static timing analysis on the pre-layout design
Analyze average and peak power consumptions
Verify the results of running MV rule checks on the gate-level design
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Objectives
At the end of this workshop, using the Front-End Synopsys Eclypse Low-Power Flow, you should be able to perform the following high-level design objectives:
Create, interpret, and apply UPF files that capture the stated power intent requirements
Synthesize designs for the power intent and power-optimization requirements using both top-down and hierarchical UPF methodologies
Describe the effect of performing a supply-net-aware always-on synthesis
Insert scan chains taking into account the existing power domains while minimizing switching activity
Ensure that the gate-level design is MV clean
Ensure equivalence checking of logic functionality between RTL and gate- level using the design and UPF files
Perform static timing analysis
Generate peak and average power analysis reports/waveforms
Analyze gate-level design for MV rule violations
Write out all needed files for physical implementation
Audience Profile
Logic design and/or verification engineers who have a need to implement, analyze, and verify designs requiring the lowest possible power consumption using the Synopsys Front-End Eclypse Low Power Flow. CAD Engineers and Managers responsible for Low Power flow will also find this workshop beneficial.
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Prerequisites
To benefit the most from the material presented in this workshop, students need:
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A basic working knowledge of Synopsys Design Compiler and PrimeTime tools. Working knowledge of the other Synopsys tools used (list at the end of course description) in the workshop is desirable, but not required, to complete this workshop
An awareness of the basics of low-power design techniques. This workshop teaches how to implement these techniques
Course Outline
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1.
Introduction to Low Power Solution
Specifying Power Intent: UPF (Lab)
RTL Synthesis (Lab)
Hierarchical UPF Flow and DFT (Lab)
2.
Lab-4: Hierarchical UPF Flow and DFT (Lab Contd.)
Logic Equivalence Checking (Lab)
Static Timing and Power Analysis (Lab)
Multi Voltage Rule Checking (Lab)?

 

 
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上海總部培訓(xùn)基地

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(地鐵11號(hào)線白銀路站2號(hào)出口旁,云屏路和白銀路交叉口)
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(地鐵昌平線沙河站B出口) 郵編:102200 行走路線:請(qǐng)點(diǎn)擊這查看
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傳真:010-51292078
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(地鐵一號(hào)線邁皋橋站1號(hào)出口旁,近南京火車(chē)站)
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.(2014年7月11).................................................................................Python培訓(xùn)課程 AMESIM模擬分析培訓(xùn) 歐姆龍PLC培訓(xùn)課程 CAE模擬分析培訓(xùn)課程 機(jī)械應(yīng)力模擬分析培訓(xùn) 集成電路培訓(xùn) 有限元模擬分析培訓(xùn) Abaqus模擬分析培訓(xùn) Simulink建模仿真培訓(xùn) Ansys Workbench模擬培訓(xùn) FPGA課程 Labview培訓(xùn)課程 R語(yǔ)言醫(yī)藥培訓(xùn)課程 機(jī)器視覺(jué)培訓(xùn) PLC培訓(xùn)課程 Vision Pro培訓(xùn)課程 信號(hào)采集分析培訓(xùn) 集成電路設(shè)計(jì)培訓(xùn) 散熱模擬分析培訓(xùn) Abaqus模擬培訓(xùn) Matlab建模仿真培訓(xùn) Ansys Workbench模擬培訓(xùn) R語(yǔ)言大數(shù)據(jù)分析培訓(xùn)課程 工業(yè)機(jī)器人分析培訓(xùn) 生產(chǎn)線模擬分析培訓(xùn)課程 運(yùn)動(dòng)控制培訓(xùn) PLC培訓(xùn)課程 APD SiP培訓(xùn)課程 電機(jī)控制培訓(xùn) 集成電路培訓(xùn) 散熱模擬分析培訓(xùn) 數(shù)字電源培訓(xùn) Matlab數(shù)學(xué)建模仿真培訓(xùn) Ansys Workbench模擬培訓(xùn) R語(yǔ)言培訓(xùn)課程 數(shù)字逆變器設(shè)計(jì)培訓(xùn) R語(yǔ)言神經(jīng)網(wǎng)絡(luò)培訓(xùn)課程 AMESIM模擬分析培訓(xùn) PLC培訓(xùn)課程 APD SiP培訓(xùn)課程 工業(yè)設(shè)計(jì)模擬分析培訓(xùn) 集成電路培訓(xùn) 散熱模擬分析培訓(xùn) Abaqus熱處理模擬培訓(xùn) Matlab建模仿真培訓(xùn) Ansys Workbench模擬培訓(xùn) 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